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LDR(Low Date Rate) UWB(Ultra Wide Band) 시스템에서 chaotic 신호를 이용한 OOK(On Off Keying) 통신 방법이 선택적 사항으로 채택되어 있다. 이 시스템에서 중요 회로 중에 하나인 chaotic 신호 발생 회로는 현재 대부분 아날로그 형태의 피드백 구조를 이용하고 있으나, 아날로그 형태의 피드백 구조는 공정 변화에 대한 취약점이 있어 양산성에 어려움이 있다. 이를 해결하기 위해 본 논문에서는 0.18 um CMOS 공정을 이용하여 디지털구조의 PN-sequence를 응용하여 중심 주파수 4 GH에서 2 ㎓의 대역폭을 갖는 Quasi-chaotic 신호 발생 회로를 설계 및 검증하였다.
목차
요약
Abstract
Ⅰ. 서론
Ⅱ. 회로 설계
Ⅲ. 측정 결과
Ⅳ. 결론
참고문헌
참고문헌 (6)
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1. [기타자료] - A. Batra / 2003 / Multi-band OFDM physical layer proposal / IEEE 802.15. Task Grorp 3a
2. [학술지(정기간행물)] - T. Stojanovski / 2001 / Chaos-based random number generators-Part I: Analysis / IEEE Trans. Circuits and System I 48 (2) : 281 ~ 288
3. [학술대회논문] - H. J. Song / 2002 / CMOS circuit design and implementation of the discrete time chaotic chip / Proc. IEEE Int Symp. Circuit and System 3 : 73 ~ 76
4. [학술대회논문] - Eng-Ting Hsu / 2005 / Design of low power with low phase noise of VCO by CMOS process / Proc. APMC. 2005 2 : 4 ~
5. [학술지(정기간행물)] - Rana Ram Singh / 2005 / A high speed high divide-by- value dual-modulus CMOS prescaler / IEEE Trans. Circuits and System 2 : 1 ~ 4
2. [학술지(정기간행물)] - T. Stojanovski / 2001 / Chaos-based random number generators-Part I: Analysis / IEEE Trans. Circuits and System I 48 (2) : 281 ~ 288
3. [학술대회논문] - H. J. Song / 2002 / CMOS circuit design and implementation of the discrete time chaotic chip / Proc. IEEE Int Symp. Circuit and System 3 : 73 ~ 76
4. [학술대회논문] - Eng-Ting Hsu / 2005 / Design of low power with low phase noise of VCO by CMOS process / Proc. APMC. 2005 2 : 4 ~
5. [학술지(정기간행물)] - Rana Ram Singh / 2005 / A high speed high divide-by- value dual-modulus CMOS prescaler / IEEE Trans. Circuits and System 2 : 1 ~ 4
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