넓은 주파수 범위에서 동작하는 분수형 위상고정 루프의 구현 및 분석

윤재광; 김수환

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자료유형: 학술대회자료

저자정보: 윤재광 (서울대학교) 김수환 (서울대학교)

저널정보: 대한전자공학회 대한전자공학회 학술대회 2022년도 대한전자공학회 하계종합학술대회 논문집

발행연도: 2022.6

수록면: 345 - 348 (4page)

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In this paper, a fractional-N phase locked-loop (PLL) is implemented using a wide range of MMDs to ensure a wide voltage controlled oscillator frequency range, and analyzed through functional simulation. Designed in a 110㎚ CMOS process, this fractional-N PLL supports both integrated mode and fractional mode, producing a wide clock frequency range. The operating range is from 0.4 ㎓ to 1.6 ㎓ and the division range is 4-63. The proposed PLL has 2.12 ps of RMS jitter in integer mode, 6.11 ps of RMS jitter in fractional mode, and consumes 16.9 ㎽ of power in fractional mode.

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