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논문 기본 정보

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학술저널
저자정보
Sungyoun Hwang (Kyungpook National University) Hyelin Seok (Kyungpook National University) Yongtae Kim (Kyungpook National University)
저널정보
대한전자공학회 JOURNAL OF SEMICONDUCTOR TECHNOLOGY AND SCIENCE Journal of Semiconductor Technology and Science Vol.24 No.4
발행연도
2024.8
수록면
305 - 315 (11page)
DOI
10.5573/JSTS.2024.24.4.305

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This paper introduces a novel and efficient approximate 4-2 compressor and multipliers that significantly improve overall computation accuracy with marginal hardware overhead. The proposed compressor incorporates an error recovery logic to rectify output errors under specific input conditions. As a result, the proposed multipliers, featuring this error recovery compressor, exhibit substantial improvements in normalized mean error distance (NMED) and mean relative error distance (MRED) by up to 89.8% and 97.1%, respectively, compared to existing approximate multipliers considered in this paper. Furthermore, when implemented in a 32-nm CMOS technology, the proposed designs enable noteworthy reductions of up to 25.2%, 22.9%, and 23.4% in area, power, and energy, respectively, in comparison to the alternative designs. The effectiveness of the proposed design is further validated through its application in a digital image processing algorithm.

목차

Abstract
I. INTRODUCTION
II. PROPOSED APPROXIMATE COMPRESSOR AND MULTIPLIER DESIGNS
III. EXPERIMENTAL RESULTS
IV. CASE STUDY: IMAGE PROCESSING
V. CONCLUSIONS
REFERENCES

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