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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2019.6
- 수록면
- 388 - 394 (7page)
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블록암호 알고리듬 ARIA와 AES 그리고 해시 함수 Whirlpool을 단일 하드웨어로 통합 구현한 AAW(ARIA- AES-Whirlpool) 크립토 코어를 Cortex-M0 CPU에 슬레이브로 인터페이스한 보안 SoC(System-on-Chip) 설계에 대해 기술한다. AAW 크립토 코어는 ARIA, AES, Whirlpool의 알고리듬 특성을 이용한 하드웨어 공유를 통해 저면적으로 구현되었으며, 128-비트와 256-비트의 키 길이를 지원한다. 설계된 보안 SoC 프로토타입을 FPGA 디바이스에 구현하고, 하드웨어-소프트웨어 통합 검증을 하였다. AAW 크립토 코어는 5,911 슬라이스로 구현이 되었으며, AAW 크립토 코어가 포함된 AHB_Slave는 6,366 슬라이스로 구현되었다. AHB_Slave의 최대 동작 주파수는 36 MHz로 예측되었으며, ARIA-128, AES-128의 데이터 처리율은 각각 83 Mbps, 78 Mbps이고, Whirlpool 해시 함수의 512-비트 블록의 처리율은 156 Mbps로 평가되었다.
목차
Abstract
요약
Ⅰ. 서론
Ⅱ. ARIA, AES 블록암호 및 Whirlpool 해시 함수
Ⅲ. Cortex-M0 기반의 보안 SoC 설계
Ⅳ. BFM 시뮬레이션 및 FPGA 검증
Ⅴ. 결론
References
참고문헌 (10)
참고문헌 신청
Ali Ismail Awad / 2018 / Chapter : 1, The Institution of Engineering and Technology(IET) / The Institution of Engineering and Technology (IET)
Neowine developed security SoC DORCA -3supporting asymmetric-key encryption
MS500: Low Power, Advanced Security Features for IoT
P. Choi / 2017 / Design and Implementation of High-Performance and Low-Complexity Security System on Chip (SoC)
A. P. Deb Nath / 2018 / System-on-chip security architecture and CAD framework for hardware patch / 201823rd Asia and South Pacific Design Automation Conference (ASP-DAC) :733~738
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