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논문 기본 정보
- 자료유형
- 학술대회자료
- 저자정보
- 발행연도
- 2021.10
- 수록면
- 1,922 - 1,925 (4page)
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The proposed spread-spectrum clock generator (SSCG) was to improve the jitter signal integrity of eye diagram from the experimental result was compared on system on chip (SOC). The proposed fully integrated circuit consists of continuous-time low-pass sigma delta (Σ-△) analog to digital converter (ADC), voltage control oscillator (VCO), current-reused LC injection locked frequency divider by 8 (ILFD ÷8) as linear mixers and Gm-C loop filter. Ultimately, this design successfully reduced radio frequency interference (RFI) with a smaller spreading ratio as compared with existing design to achieve optimal signal integrity and implemented in Bio-systems of control wireless systems.
목차
Abstract
1. INTRODUCTION
2. INTEGRATED CIRCUITS DESIGN
3. EXPERIMENTAL
4. CONCLUSIONS
REFERENCES
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